HW/SW Codesign an der TU München

Karteikarten und Zusammenfassungen für HW/SW Codesign an der TU München

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Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

Name and explain two important subsystem communication models!

Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

Enumerate some advantages of hierarchical modeling!

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Assign each of the following models of computation to a model class:

communicating FSMs, message sequence chart, differential equations, component block diagram

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Explain the principle and possible applications of a "virtual prototype"!

Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

What is an „executable specification“? What is its purpose?

Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

What is meant by refinement?

Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

What correspondence can be found between simulation accuracy, simulation time and abstraction layer?

Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

What is the goal of an accurate system specification and exploration on a high abstraction layer?

Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

How is the repeated, consecutive iteration of specification, exploration and refinement called?

Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

Describe the main purposes of the specification-, exploration- and refinement-phase in the system design process.

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Which computing power can you expect from an FPGA with a dimension of 3x3 mm in 0,25 µm CMOS technology?
Assumption: CD(FPGA) = 400
Compare the result with a 32-bit RISC CPU at 400 MHz using the same technology.

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An embedded system contains three different components with a MTTF of 200’000, 300‘000 and 600‘000 hours according to the data sheets.
Calculate the system’s reliability under the following assumptions:
a) the components are independent,
b) the error probability of the single systems is distributed exponentially.

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Beispielhafte Karteikarten für HW/SW Codesign an der TU München auf StudySmarter:

HW/SW Codesign

Name and explain two important subsystem communication models!

shared-memory, message-passing, …

HW/SW Codesign

Enumerate some advantages of hierarchical modeling!

reduced complexity=> clarity, re-use of elements on different layers, simplified refinement

HW/SW Codesign

Assign each of the following models of computation to a model class:

communicating FSMs, message sequence chart, differential equations, component block diagram

CFSM –> state-oriented

MSC –> structure-oriented

diff. equations –> time-oriented
CCD –> structure-oriented

HW/SW Codesign

Explain the principle and possible applications of a "virtual prototype"!

cycle-/instruction- accurate HW-model, which is used for SW-development => parallelization between HW- and SW- development => time-to-market!

HW/SW Codesign

What is an „executable specification“? What is its purpose?

formal system model, machine-readable and simulatable => executable; gives a precise prediction of later system, basis for system synthesis and implementation (reference solution)

HW/SW Codesign

What is meant by refinement?

Transition from a higher to a lower abstraction layer in same view with adding of more details

HW/SW Codesign

What correspondence can be found between simulation accuracy, simulation time and abstraction layer?

The lower the abstraction layer, the more accurate and time consuming is the simulation

HW/SW Codesign

What is the goal of an accurate system specification and exploration on a high abstraction layer?

Recognition of design failures in an early project phase and avoidance of costly iterations

HW/SW Codesign

How is the repeated, consecutive iteration of specification, exploration and refinement called?

Design flow

HW/SW Codesign

Describe the main purposes of the specification-, exploration- and refinement-phase in the system design process.

Specification: Description of system behavior using a formal, executable model

Exploration: comparison of implementation alternatives concerning performance and costs
refinement: synthesizing a structural system description out of a functional specification

HW/SW Codesign

Which computing power can you expect from an FPGA with a dimension of 3x3 mm in 0,25 µm CMOS technology?
Assumption: CD(FPGA) = 400
Compare the result with a 32-bit RISC CPU at 400 MHz using the same technology.

Rabs = CD x N;
N = area in technology squares Lmin^2

3×3 mm FPGA: N = 144 x106 in 0.25 μm CMOS
Rabs(FPGA) = 57,6 Gops

RISC CPU: 1 x 32 bit operation per cycle
Rabs(RISC) = 400 Mops

Rabs(FPGA) = 144 x Rabs(RISC)

HW/SW Codesign

An embedded system contains three different components with a MTTF of 200’000, 300‘000 and 600‘000 hours according to the data sheets.
Calculate the system’s reliability under the following assumptions:
a) the components are independent,
b) the error probability of the single systems is distributed exponentially.

Components are independet + error probability is distributed exponentially
–> failure_rate(system) =
∑ failure_rate(component)

fail_rate(system) = 6/600‘000 h
MTTF(system) = 100‘000 h

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