ACA an der TU München

Karteikarten und Zusammenfassungen für ACA im Technologie- und Managementorientierte Betriebswirtschaftslehre (TUM-BWL) Studiengang an der TU München in Augsburg

CitySTADT: Augsburg

CountryLAND: Deutschland

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Beispielhafte Karteikarten für ACA an der TU München auf StudySmarter:

What is CPU Time?

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Example of Processor "Knights Landing"

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What is Wall-Clock Time/elapsed time?

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Techniques for performance evaluation?

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Definition Computer Architecture

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What are metrics to assess performance?

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Branch Prediction

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Execution

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Control Hazard

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Instruction Issue

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Rename/Allocation

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Decode

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ACA

What is CPU Time?
Time when CPU is active (+User Time: for executing program, System Time (OS services)

ACA

Example of Processor "Knights Landing"
MIC (Many Integrated Cores) architecture which is targeted at highly parallel, high throughput workload. Massive Thread parallelism. Massive data parallelism, high memory bandwidth

ACA

What is Wall-Clock Time/elapsed time?
Latency of the execution, including wait time for disk access etc.

ACA

Techniques for performance evaluation?
Hardware Characteristics, Benchmarking, Monitoring, Simulation, analytical Modeling

ACA

Definition Computer Architecture
In computer science and engineering, computer architecture is the practical art of selecting and interconnecting hardware components to create computers that meet functional, performance and cost goals; and the formal modelling of those systems

ACA

What are metrics to assess performance?
Execution time of a program, MFLOPS, Storage Capacity, Throughput, Graphics resolution, MIPS

ACA

Branch Prediction
Prediction of branch decision when a jump is encountered -> The branch which is guessed to be the most likely is fetched and speculatively executed. Either correct or flush

ACA

Execution
Instructions are executed

Variety of units: integer, floating-point and logical operations, and also SIMD units (e.g. SSE)

Bypass logic (forward logic): wires that move results from one unit to the input of other units

The design of the bypass network is critical since wire delays do not scale at the same pace as gate delays. They have an important contribution to the cycle time of the processor

ACA

Control Hazard
Next instruction can only be loaded after three cycles

Handling:
Early computation in ID: condition and target should be computed already in ID -> require new ALU, RAW Hazard, Critical path in ID phase is prolongated

Delay slot: Inserting of independent instruction -> by compiler, fill the stall with an independent instruction, can be used in combination with previous technique

Branch Prediction

ACA

Instruction Issue
Instruction wait in the queue until all operands and the functional unit are available.

For in-order processors only the first element is checked, for out-of order processors all the instructions need to be checked per clock cycle

ACA

Rename/Allocation
Register renaming for removing name dependences

Allocation of entries in the reorder buffer, the issue queue and the load/store queue. If resources are not available, the instruction is stalled until instruction releases the required resources. The the instruction is dispatched

ACA

Decode
Identify instruction type (e.g. control flow) and required resources (e.g. register ports, functional units)
Decoders based on ROMs or ad-hoc circuitry
Gradient

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Business Law I

Introduction to Business Ethics

Consumer Behaviour Research Methods

Introduction to entrepreneurship

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Logistik in der Automobilindustrie

InfoManagement

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